Static Timing Analysis

Project : NFC_TAG_V100
Build Time : 01/06/16 11:15:43
Device : CY8C4245FNI-483
Temperature : -40C - 85C
VDDA : 3.30
VDDD : 3.30
Voltage : 3.3
Expand All | Collapse All | Show All Paths | Hide All Paths
+ Timing Violation Section
No Timing Violations
+ Clock Summary Section
Clock Domain Nominal Frequency Required Frequency Maximum Frequency Violation
Clock_1(FFB) Clock_1(FFB) 10.000 kHz 10.000 kHz N/A
CyHFCLK CyHFCLK 24.000 MHz 24.000 MHz N/A
I2C_1_SCBCLK CyHFCLK 1.600 MHz 1.600 MHz N/A
UART_1_SCBCLK CyHFCLK 1.412 MHz 1.412 MHz N/A
Clock_1 CyHFCLK 10.000 kHz 10.000 kHz N/A
CyILO CyILO 32.000 kHz 32.000 kHz N/A
CyIMO CyIMO 24.000 MHz 24.000 MHz N/A
CyLFCLK CyLFCLK 32.000 kHz 32.000 kHz N/A
CyRouted1 CyRouted1 24.000 MHz 24.000 MHz N/A
CySYSCLK CySYSCLK 24.000 MHz 24.000 MHz N/A
I2C_1_SCBCLK(FFB) I2C_1_SCBCLK(FFB) 1.600 MHz 1.600 MHz N/A
UART_1_SCBCLK(FFB) UART_1_SCBCLK(FFB) 1.412 MHz 1.412 MHz N/A