[Icestudio][Estable] Hacia Icestudio 0.10 (estable)

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Obijuan

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May 9, 2022, 5:27:12 AM5/9/22
to FPGAwars: explorando el lado libre
Hola,

Estamos a punto de cerrar otro ciclo de desarrollo. La próxima versión estable de icestudio será la 0.10

Durante este ciclo nos hemos centrado, fundamentalmente, en documentar y refactorizar el código. Todavía queda mucho por hacer, pero es conveniente sacar releases estables con frecuencia

Las fases para llegar a la 0.10 son:

* 1) Solucionar Bug 1 (Charli): El spinner de espera no aparece al entrar/salir de los bloques
* 2) Solucionar Bug 2: Reordenación de los cables al entrar en un cable, reportado por Joaquim. Hay que recopilar más información (Yo creo que está solucionado con el bug 1)
* 3) CONGELACION: Integrar la versión de develop actual (0.9.2w) con la rama master (estable).  A partir de este momento ya sólo se solucionarán bugs críticos

* 4) Actualización de traducciones: Es el momento de añadir/actualizar las traducciones

* 5) Sacar la RC1: Icestudio-0.10-rc1 (Release candiate 1). Aquí es será el momento de instalar icestudio desde 0 para detectar bugs críticos en la instalación, y solucionarlos

* 6) Se sacarán tantas RCn como bugs críticos se detecten y se solucione

* 7) Sacar la versión Icestudio-0.10 final

* 8) Comenzar un nuevo ciclo (0.10.1w)

En este hilo iremos comentando los avances

Saludos, Obijuan

Obijuan

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May 9, 2022, 5:34:05 AM5/9/22
to FPGAwars: explorando el lado libre

De momento, Icestudio pasa a la versión 0.10 y no la 1.0 porque todavía lo seguimos considerando como una herramienta experimental. Es decir, un programa en el que los desarrolladores estamos experimentando cosas, y también aprendiendo. Una vez que tengamos claras las características claves, podremos fijar qué incluir en la versión 1.0

Pero de momento seguimos experimentando

Saludos, Obijuan



Obijuan

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May 10, 2022, 2:33:02 AM5/10/22
to FPGAwars: explorando el lado libre
Gracias a Carlos, el bug 1 ya está solucionado 🙂️

Roadmap:

1) [x] Bug 1 Solucionado

Pendiente:

2) [  ] Bug 2: Está parcialmente solucionado. Necesitamos que más gente lo pruebe. Es un bug menor, de manera que si no se soluciona del todo, se puede seguir avanzando
3) [  ] Congelar: Mergear a Master
4) [  ] Actualizar traducciones
5) [  ] Sacar la Release cantidate 1 (Icestudio-0.10-rc1)
6) [  ] Pruebas
7) [ ] Versión Final (Icestudio-0.10)   

Obijuan

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May 10, 2022, 3:53:55 PM5/10/22
to FPGAwars: explorando el lado libre
Gracias otra vez a Carlos, el bug 2 ya está solucionado 🙂️
Luz verde para el siguiente hito! Vaaaaaamos!!!!

Roadmap:

1) [x] Bug 1 Solucionado
2) [x] Bug 2 Solucionado

Pendiente:

3) [  ] Congelar: Mergear a Master
4) [  ] Actualizar traducciones
5) [  ] Sacar la Release cantidate 1 (Icestudio-0.10-rc1)
6) [  ] Pruebas
7) [ ] Versión Final (Icestudio-0.10)   


charli va

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May 10, 2022, 4:07:08 PM5/10/22
to fpga-wars-explora...@googlegroups.com
Vamoos! equipazo! 

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Obijuan

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May 14, 2022, 8:28:10 AM5/14/22
to FPGAwars: explorando el lado libre
Ya está disponible Icestudio-0.10-rc1. Lo podéis descargar desde aquí:


Es importante que la probéis desde cero, para comprobar si el proceso de instalación funciona correctamente cuando se empieza desde 0 (Si eliminais la carpeta .icestudio se borran todas las toolchain y los perfiles)

A partir de ahora sólo se solucionarán Errores críticos y se admitirán  actualizaciones de las traducciones

Para Añadir traducciones sólo tenéis que clonaros la rama master de icestudio y editar el correspondiente fichero .po (usando el poedit). Los fichero .po se encuentran en icestudio/resources/locale

De momenrto sólo la traducción al Español está al 100%. Los porcentajes del resto de idiomas los podéis ve aquí:


Os animo a actualizar las traducciones, antes de liberar Icestudio 0.10. Muchísimas gracias

Saludos, Obijuan

Democrito

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May 14, 2022, 3:49:41 PM5/14/22
to FPGAwars: explorando el lado libre
He estado probando y de momento todo bien en esta RC. Saludos!

Obijuan

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May 15, 2022, 3:09:13 AM5/15/22
to FPGAwars: explorando el lado libre
Muchísimas gracias por las pruebas, Demócrito! 🙂️

Esta versión 0.10-rc1 es muy crítica, porque hay muchos cambios internos y se han roto muchas cosas

Yo estoy encontrando bastantes bugs raros, que me cuesta reproducirlos, por eso necesito que más gente lo pruebe a tope. Todos los errores que encuentre y sean reproducibles los pondré aquí. Esta fase de estabilización creo que va a ser complicada, pero poco a poco lo lograremos. ¡Vaaaamos!

Saludos, Obijuan

Obijuan

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May 15, 2022, 3:51:31 AM5/15/22
to FPGAwars: explorando el lado libre
Recopilo el estado actual.

Estamos probando Icestudio 0.10-rc1

Bugs encontrados:
* Bug 1:  La colección "Default" desaparece del menú. (Reportado por Demócrito)
* Bug 2: Al abrir un nuevo proyecto se queda la pantalla de arranque en bucle infinito (Reportado por Obijuan)

Seguimos a la espera de pruebas de la comunidad, sobre todo relacioandas con la instalación desde cero. También es el momento de recibir actualizaciones de las traducciones

Cuando se solucionen esos bugs pasamos a Icestudio 0.10-rc2 y volvemos a hacer todas las pruebas posibles

Esto se repite mientras se encuentren fallos críticos

Saludos, Obijuan

Democrito

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May 22, 2022, 1:43:56 PM5/22/22
to FPGAwars: explorando el lado libre
Hola,

He detectado dos errores graves, pero uno de ellos todavía no consigo reproducirlo.

El que puedo reproducir sin problema es el siguiente: (estoy en plataforma Windows)

1.) Del circuito principal haces doble clic a un módulo. Entras en ese módulo, o sub-módulos si ese fuese el caso.
2.) Le das a la opción "guarda como" (sin que haga falta poder editar). El circuito se guardará correctamente.
3.) Le das para volver al circuito principal.
4.) Se queda colgado ahí todo el rato.

Pongo un gif animado para verlo más claro.

error_guardar_como_en_modulo.gif


Nótese que sólo sucede este error si le damos a la opción "guardar como". Lo podéis probar con cualquier circuito vuestro que contenga un módulo dentro del circuito, por eso no adjunto ninguno.

Saludos!

Democrito

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May 22, 2022, 1:58:08 PM5/22/22
to FPGAwars: explorando el lado libre
Pensaba que, pese al error, el archivo se guardaba correctamente y no así. Ahora si os adjunto el circuito donde he hecho la prueba (es un circuito con poco sentido, que hace de puerta not pero con un always e "ifs".

fallo_en_archivo_gurdado_como.gif

"prueba_error_verificar.ice" es el circuito que usé primero del gif primero.
"prueba_prueba.ice" es el circuito que se guardó al estar dentro de un módulo y le di a la opción "guardar como".
prueba_error_verificar.ice
prueba_prueba.ice

Democrito

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May 22, 2022, 3:21:22 PM5/22/22
to FPGAwars: explorando el lado libre
Otro bug, pero este no es crítico.

Cuando copio un circuito y lo pego a uno nuevo, salen algunas entradas y etiquetas con formato de entrada física. Esto ya era conocido, pero ahora en el caso de las etiquetas no deja cambiar el color, pero hay un truco: se trata de cambiar el color a otro diferente y luego poner el que tú querías.

copiar y pegar a un circuito nuevo error etiquetas no cambia de color.gif


Democrito

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May 22, 2022, 3:43:39 PM5/22/22
to FPGAwars: explorando el lado libre
Lo que comento a continuación no es otro bug, sino sobre el comportamiento de un bug anterior. Me refiero al bug donde el scroll de la caja de código salían erráticas y sin sentido. Resulta que al maximizar o modificar la ventana se resuelve el problema.

error de las cajas de codigo se resuelve al maximizar.gif




charli va

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May 23, 2022, 12:12:48 AM5/23/22
to fpga-wars-explora...@googlegroups.com
Gracias Demócrito! a por ellos voy!

El dom, 22 may 2022 a las 21:43, Democrito (<spo...@gmail.com>) escribió:
Lo que comento a continuación no es otro bug, sino sobre el comportamiento de un bug anterior. Me refiero al bug donde el scroll de la caja de código salían erráticas y sin sentido. Resulta que al maximizar o modificar la ventana se resuelve el problema.

error de las cajas de codigo se resuelve al maximizar.gif




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charli va

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May 24, 2022, 12:34:21 PM5/24/22
to fpga-wars-explora...@googlegroups.com
Buenas! esto ya está resuelto, nueva WIP lista.

En algún momento de la refactorización o por otros cambios, han saltado estos bugs. Realmente el tema es que en los submodulos no se puede guardar salvo "guardar como" sólo cuando tienes el bloque en modo edición (que funciona como un exportador para ese módulo).

Seguimos!

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charli va

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May 24, 2022, 12:35:07 PM5/24/22
to fpga-wars-explora...@googlegroups.com
Si puedes chequea que esto haya quedado solucionado con el bug anterior.

Gracias!

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charli va

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May 24, 2022, 12:36:49 PM5/24/22
to fpga-wars-explora...@googlegroups.com
¿Me podrías pasar este fichero para probar?

El dom, 22 may 2022 a las 21:43, Democrito (<spo...@gmail.com>) escribió:
Lo que comento a continuación no es otro bug, sino sobre el comportamiento de un bug anterior. Me refiero al bug donde el scroll de la caja de código salían erráticas y sin sentido. Resulta que al maximizar o modificar la ventana se resuelve el problema.

error de las cajas de codigo se resuelve al maximizar.gif




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Democrito

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May 24, 2022, 6:32:37 PM5/24/22
to FPGAwars: explorando el lado libre
Hola Carlos,

Me he descargado e instalado la nueva wip para plataforma windows: icestudio-0.9.2w202205240405-win64.exe

Acabo de hacer unas cuantas pruebas y continúan los mismos bug,  te paso a comentar.

En vez de utilizar la palabra "bug" voy a usar la palabra "gremlin" para no confundirlo con la enumeración de bugs que dio Juan en otro hilo.

Los Gremlins nº1, 2 y 3, siempre me estaré refiriendo a los ICEs que fueron creados con "Guardar como". Estos ICEs no se exportan bien y tienen los siguientes errores: 

Gremlin nº1: Cuando se accede a un módulo, si se le da a "Guardar como" (para exportar esa parte como un ICE), al abrir el fichero guardado, todas las entradas/salidas y etiquetas aparecen así (es un ejemplo de cómo se ve) :

gremlin1.PNG

Glemlin nº2: Seguimos en el mismo archivo (el que se exportó con "Guardar cómo" y lo tenemos abierto). Otra cosa que se aprecia es que en las cajas de código no aparece correctamente el código y además hace un scroll raro en las primeras dos líneas especialmente (el resto del texto del código no aparece).

Vuelvo a poner el gif animado que puse en varios post arriba para que se vea otra vez, porque sigue haciendo eso mismo.

error de las cajas de codigo se corrije al redimensionar la ventana.gif

Recuerda que esto sólo sucede con los ICEs que fueron guardados con la opción "guardar como". Te adjunto un ejemplo al que le he llamado "Guardado_como.ice"

Lo abres, y pincha con el ratón dentro de cualquiera de las cajas de código, y tratas de subir y bajar el texto del código, a mi no me sale correctamente, me sucede lo que ves en el gif de esta sección. Sin embargo, cuando redimensionas la ventana o le das a maximizar la ventana, desaparece este problema en concreto y aparece el texto del código correctamente.

Glemlin nº3: Sucede con las etiquetas, salen con la misma caja como si fuesen pines o buses de entrada/salida (ver imagen del Glemlin nº1). Y cuando tratas de que vuelva a su naturaleza de etiqueta, no se pondrá como etiqueta hasta que "fuerzas" a ponerle otro color. Una vez que le cambias el color, entonces te permite poner el que realmente quieres (y debería llevar). La única etiqueta que ves con color (un "clk" de color amarillo) la forcé yo, por defecto las etiquetas no se distinguen de las I/O físicas.

Y hasta aquí todo lo que he detectado en los ICE que fueron creados con "Guardar como". Nada de esto sucede en un ICE "normal". Se supone que el problema estará en esa parte del programa de Icestudio.

Y falta un último Glemlin, el peor de todos y afecta a los ICEs "normales" y a los exportados.

Glemlin nº4: Si estás dentro de cualquier módulo, cuando le das a "Verificar" y contiene errores de verilog (o de diseño), no sale el mensaje "Hay errores en el diseño". Pues bien, además de eso, cuando tratas de volver al ICE principal, no te deja hacerlo y se queda el mismo circuito (el módulo) como si fuese el principal. Imagen de lo que sucede:

cuelgue si hay error en la verificacion.gif

Para reproducir este error te adjunto el ICE: "Cuelgue_al_verificar_si_existen_errores.ice"

Paso 1.) Abres ese ICE.
Paso 2.) Haz doble clic al módulo derecho, con el nombre "Sign Q16.16 send TX Decimal +-65535"
Paso 3.) Dale a "Verificar".
Paso 4.) Icestudio da el mensaje que la verificación es correcta. (es un módulo sin errores)
Paso 5.) Vuelve al ICE principal.
Paso 6.) Ahora hacemos doble clic al módulo del medio, con nombre "Inverse_CLONE". (este módulo contiene errores a propósito)
Paso 7.) Dale a "Verificar".
Paso 8.) Comenzará a verificar, pero contiene errores. No da ningún mensaje.
Paso 9.) Ahora trata de ir al circuito principal. No deja y ahora el contenido del módulo se ha convertido en el circuito principal. Y si cometes el error de salvarlo (control S) se guarda lo que ves en pantalla, es decir, el módulo y el circuito principal se pierde.

Si en algo no me explicado bien me lo dices!

Saludos!

Post Data:

Tengo entendido que la palabra "Gremlin" viene de los problemas que sufrían los aviones de guerra de la RAF (UK) en la Segunda Guerra Mundial. Habían aviones que funcionaban bien, pero por motivos extraños a veces ocurrían fallos mecánicos, que luego una vez en tierra no se volvían a reproducir. A ese tipo de fallos los llamaron así, desde el imaginario de pequeños pitufos malvados que en ciertos momentos hacían mal funcionar los equipos y/o la mecánica del avión. Probablemente se tomó este nombre para la famosa película de los años 80 llamada "Los Glemlins".
Guardado_como.ice
Cuelgue_al_verificar_si_existen_errores.ice

Democrito

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May 24, 2022, 7:39:26 PM5/24/22
to FPGAwars: explorando el lado libre
Acabo de hacer una prueba muy simple. He tomado el RISCV de Obijuan, y he buscado un módulo que contenga caja de código. Si meto otra y contiene errores (o simplemente está vacía) se reproduce el Gremlin n4 (al verificar no da mensaje de error y deja de ser posible ir hacia atrás).

error si dentro de un módulo hay varias cajas de código y una de ellas tiene errores.gif


charli va

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May 24, 2022, 7:43:37 PM5/24/22
to fpga-wars-explora...@googlegroups.com
Gracias Demócrito! tus pruebas son coj... en lo que has reportado  hay algunos errores de concepto que tengo que evaluar a ver como afrontarlo.

Por otro lado no sé muy bien por qué te sigue dejando guardar con el candado cerrado, es como si no se hubieran subido los cambios (Es el único bug qeu solucioné hasta el momento).

Ahora lo reviso.

El mié, 25 may 2022 a las 1:39, Democrito (<spo...@gmail.com>) escribió:
Acabo de hacer una prueba muy simple. He tomado el RISCV de Obijuan, y he buscado un módulo que contenga caja de código. Si meto otra y contiene errores (o simplemente está vacía) se reproduce el Gremlin n4 (al verificar no da mensaje de error y deja de ser posible ir hacia atrás).

error si dentro de un módulo hay varias cajas de código y una de ellas tiene errores.gif


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Democrito

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May 24, 2022, 7:43:54 PM5/24/22
to FPGAwars: explorando el lado libre
Según me ha parecido el Glemlin nº4 se produce especialmente cuando en la caja de código contiene el "clk".

charli va

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May 24, 2022, 8:38:30 PM5/24/22
to fpga-wars-explora...@googlegroups.com
Demócrito cuando puedas prueba la nueva WIP, no te debería dejar salvar con el candado cerrado dentro de un módulo.

Si lo hace dímelo please!

El mié, 25 may 2022 a las 1:43, Democrito (<spo...@gmail.com>) escribió:
Según me ha parecido el Glemlin nº4 se produce especialmente cuando en la caja de código contiene el "clk".

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Democrito

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May 24, 2022, 8:53:38 PM5/24/22
to FPGAwars: explorando el lado libre
Carlos, todavía no he actualizado a la versión que me propones ahora, el problema que me describes no me sucede. Te dejo un gif animado para que lo veas. Si el candado está echado no se puede guardar (exportar) el módulo.

actual wip sin error de salvar como con el candado echado.gif

Mañana seguimos, he de dormir un poco! :P

Mañana sobre las 21h estaré en casa y me pongo con todos los "deberes" que me mandes.

Un abrazo!

Obijuan

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May 31, 2022, 4:45:02 AM5/31/22
to FPGAwars: explorando el lado libre
Hola!

En cuanto pueda recopilo el estado de la estable actual. Han aparecido muchos bugs críticos que hay que resolver, y yo justo ahora estoy en periodo de exámenes en la Uni. En cuanto termine lo retomo y seguimos el proceso de estabilización de Icestudio 0.10

Muchas gracias por todas las pruebas

Saludos, Obijuan

charli va

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May 31, 2022, 5:07:47 AM5/31/22
to fpga-wars-explora...@googlegroups.com
Buenas! Yo ando trabajando en ello, hay algunos “errores de concepto” que realmente están ahí desde el inicio pero realmente no habían saltado o nadie lo había usado “en serio” así que gracias Democrito!

Estos días según vaya cerrando cosas os iré avisando, también dejaré subido un tema nuevo de configuración.

Un abrazo!

--
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Obijuan

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Feb 4, 2023, 11:02:27 AM2/4/23
to FPGAwars: explorando el lado libre
Hoy he retomado esta parte que se quedó pendiente....  La última release estable fue la 0.10-rc1, que se liberó el 24-Mayo-2022...  Aunque después aparecioron algunos bus menores, la versión es muy estable. Fue la que hemos usado este cuatrimestre en la asignatura de Mecatrónica en el grado de Ingeniería de Robótica Software en la URJC

Simplemente he liberado hoy la 0.10-rc1 como la 0.10 (para que aparezca en github como la última estable)

También he actualizado las release notes:


Como fecha de liberación aparece la de hoy, pero en realidad sólo contiene los cambios hasta el 24-mayo-2022

La versión de desarrollo la he renombrado a la 0.10.1w y he recopilado y resumido los cambios que se han hecho desde el 24-mayo-2022:


Este hilo, por tanto, ya lo considero cerrado. Abriré uno nuevo para hacer un Roadmap de la próxima estable: la 0.11

Saludos, Obijuan

charli va

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Feb 4, 2023, 11:07:10 AM2/4/23
to fpga-wars-explora...@googlegroups.com
Fenomenal!! a ver si me da tiempo a subir todos los nuevos cambios para la próxima!!! 

Gracias por el trabajo!!!

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