尝试补充一下:
Liu "Sequencer" Jiuyang
是最大的开源的RISC-V实现Rocket Chip / Chisel 的维护者
https://github.com/chipsalliance/rocket-chip
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Wang Kang
On Mon, 18 Oct 2021, Justin Wong wrote:
> 没看懂这次要讨论啥,求减少黑话使用。
> Sequencer 是主讲人吗?摸鱼怪是啥?
>
> “某基于 Scala 的电路设计语言” 看起来这个才是这次要讨论的主题?它的名字是啥?
>
> --
> Justin Wong
>
> On Mon, Oct 18, 2021, at 11:01, Yipeng Liu wrote:
> > Hi Tunars,
> >
> > Verilog 是一个邪恶的语言,从一开始就为了让自己背上沉重的历史包袱而设计。设计者们定义出宽泛的*仿真*语意,同时 EDA 大厂们分别定义出 * NDA* 的“可综合”的*无明确语意*子集,并将*错误的*设计范式强加给世人。Sequencer 是本周五(将)被路由到 TUNA 附近的摸鱼怪,一直在和数字电路搏斗,以致于 PhD 毕业困难,本周六想和 TUNA 的前辈们学习一下数字电路,加速毕业/肄业。Sequencer 将会在本次 Tunight 中试图颠覆 Verilog 强加于设计者的设计范式(绝对不是传销某基于 Scala 的电路设计语言),试图想大家忽悠清楚更加本质的数字电路设计方法学。(而且绝对不会放送打黑工广告 🚩🚩🚩)
> >
> > 活动信息:
> > * 主讲人:刘玖阳
> > * 时间:2021/10/23(周六) 19:00 UTC +08:00
> > * 活动形式:线下 + 线上会议 + 直播
> > * 地点:三教 1201
> > * 线上会议:Zoom 991 1797 4376 密码 211023
> > * 直播链接:开始后公布
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> > 欢迎一起来玩!
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> > Yipeng Liu