[Icestudio] 0.2.0 beta 1

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Jesús Arroyo

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Jun 29, 2016, 3:18:33 PM6/29/16
to FPGA-WARS: explorando el lado libre
Hola a todos,

Ya está disponible la primera beta de Icestudio 0.2.0 para Linux, Windows y Mac.

https://github.com/FPGAwars/icestudio/releases/tag/0.2.0-beta1

Es una versión con nuevos conceptos que explorar y desarrollar.

Toda duda, comentario o sugerencia comentadla en el hilo.

Que el software libre para hardware libre os acompañe! XD

Obijuan

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Jun 30, 2016, 9:00:28 AM6/30/16
to FPGA-WARS: explorando el lado libre
Gracias Jesús!  Lo he probado en Ubuntu 16.10, y me va de puta madre

Lo voy a probar también en una máquina virtual con Windows y te cuento

Es muy grande!!!! Gracias!

Saludos, Juan

Jesús Arroyo

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Jul 1, 2016, 4:13:21 AM7/1/16
to fpga-wars-explora...@googlegroups.com
Gracias Juan.

PD: he subido un video de la aplicación en su estado actual: https://www.youtube.com/watch?v=mAIKb47z2Do.

Un saludo.


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Juan Gonzalez Gomez

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Jul 1, 2016, 4:29:12 AM7/1/16
to FPGA-WARS: explorando el lado libre
El vídeo es UNA PASADA!!!! GRACIAS JESUS!!!

El diseño jerárquico con bloques es genial. De esta forma se pueden enseñar principios de electrónica digital ocultando los detalles en las "bloques". Luego, se puede ir entrando en cada bloque para aprender los detalles.

La existencia de bloques código es fundamental. Con eso ya se puede hacer prácticamente cualquier cosa. Por ejemplo, en un bloque se puede meter un procesador :-)     Bloque simplez

Las posibilidades son infinitas

Saludos, Juan

BrainCodec

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Jul 1, 2016, 7:59:07 AM7/1/16
to FPGA-WARS: explorando el lado libre
Gran trabajo Jesús.

Por lo que he podido comprobar, iceStudio genera este codigo (ejemplo de la puerta AND).




¿Tienes pensado permitir que se puedan asignar nombres a los módulos/parámetros/etc., en lugar de -o además de- generarlos de manera pseudoaleatoria?

Un saludo.

BrainCodec

unread,
Jul 1, 2016, 8:03:23 AM7/1/16
to FPGA-WARS: explorando el lado libre
Por cierto, cuando estás modificando la etiqueta de un bloque, si haces un CTRL+C (por ejemplo, para copiar esa etiqueta), además te hace un clonado del bloque ;)

BrainCodec

unread,
Jul 1, 2016, 8:07:16 AM7/1/16
to FPGA-WARS: explorando el lado libre
También si estás modificando una etiqueta y haces un CTRL+SUPRIMIR te muestra el dialogo de borrado de bloque.

Es decir, que aunque tengas delante un "supuesto" diálogo modal, en realidad el workspace de los bloques sigue teniendo el "foco" del teclado.

Pequeñas pijadas que para una Beta son de entender ;)

Un saludo.

Jesús Arroyo

unread,
Jul 1, 2016, 8:08:43 AM7/1/16
to fpga-wars-explora...@googlegroups.com
Los identificadores en verilog se generan a partir del id del bloque. Cada id es único. En la GUI se pueden asignar labels a los puertos, pero esto sólo se utiliza en la parte visual. Por ahora no se me ocurre ninguna razón para dejar al usuario modificarlo porque puede producir errores al incluir ids con el mismo nombre.

PD: sí, por ahora la funcionalidad de cortar, copiar está complementada con Ctrl+x y Ctrl+c. Efectivamente no debería lanzar el evento con el prompt. Todos estos issues los puedes añadir aquí: https://github.com/FPGAwars/icestudio/issues.

Un saludo.


El 1 de julio de 2016, 14:03, BrainCodec <brain...@gmail.com> escribió:
Por cierto, cuando estás modificando la etiqueta de un bloque, si haces un CTRL+C (por ejemplo, para copiar esa etiqueta), además te hace un clonado del bloque ;)

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BrainCodec

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Jul 1, 2016, 8:09:34 AM7/1/16
to FPGA-WARS: explorando el lado libre
Cuando estás en un "Bloque de código" si quieres copiar un trozo de código para reutilizarlo, y lo haces mediante el CTRL+C también te hace un clonado del bloque actual, mismo problema que con el dialogo de la modificación de etiqueta, pero en los bloques de código.

Un saludo.

Jesús Arroyo

unread,
Jul 1, 2016, 8:11:37 AM7/1/16
to fpga-wars-explora...@googlegroups.com
Jeje, definitivamente hay que cambiar los shortcut.

Se admiten sugerencias.

El 1 de julio de 2016, 14:09, BrainCodec <brain...@gmail.com> escribió:
Cuando estás en un "Bloque de código" si quieres copiar un trozo de código para reutilizarlo, y lo haces mediante el CTRL+C también te hace un clonado del bloque actual, mismo problema que con el dialogo de la modificación de etiqueta, pero en los bloques de código.

Un saludo.

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BrainCodec

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Jul 1, 2016, 8:16:50 AM7/1/16
to FPGA-WARS: explorando el lado libre
Con respecto a los identificadores, te lo comentaba por una mera cuestión de "reutilización" del código Verilog "desde fuera" de iceStudio, pero no hay problema un simple replace y listo! jejeje.


Un saludo.

Jesús Arroyo

unread,
Jul 1, 2016, 8:21:29 AM7/1/16
to fpga-wars-explora...@googlegroups.com
Correcto. De todas formas se me ocurre que podría ser interesante añadir la opción de exportar el verilog en formato "pretty", precisamente por lo que comentas de reutilizar código verilog.

El 1 de julio de 2016, 14:16, BrainCodec <brain...@gmail.com> escribió:
Con respecto a los identificadores, te lo comentaba por una mera cuestión de "reutilización" del código Verilog "desde fuera" de iceStudio, pero no hay problema un simple replace y listo! jejeje.


Un saludo.

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BrainCodec

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Jul 1, 2016, 8:24:51 AM7/1/16
to FPGA-WARS: explorando el lado libre
Más que cambiar los shorcuts, creo que lo que habría que hacer es que el "workspace" pierda el foco de teclado toda vez que tengas una ventana en primer plano, como es el caso del cambio de una etiqueta.

Un saludo.

P.d.: Los próximos issues los notifico por aquí: https://github.com/FPGAwars/icestudio/issues  ;)

BrainCodec

unread,
Jul 1, 2016, 8:36:11 AM7/1/16
to FPGA-WARS: explorando el lado libre
A ese respecto igual esto te puede servir: https://github.com/mithro/hdl-pretty (Scripts for prettifying VHDL and Verilog files )

Un saludo.

Jesús Arroyo

unread,
Jul 1, 2016, 8:38:54 AM7/1/16
to fpga-wars-explora...@googlegroups.com
Muchas gracias por la información! :)

El 1 de julio de 2016, 14:36, BrainCodec <brain...@gmail.com> escribió:
A ese respecto igual esto te puede servir: https://github.com/mithro/hdl-pretty (Scripts for prettifying VHDL and Verilog files )

Un saludo.

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BrainCodec

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Jul 1, 2016, 8:45:34 AM7/1/16
to FPGA-WARS: explorando el lado libre
De nada Jesús, un placer.

Una última cosa "por ahora", jajaja. 

Con respecto a los diálogos o "prompts", veo que estás utilizando Alertify... has probado con el parámetro "modal = true"


Un saludo

@braincodec

BrainCodec

unread,
Jul 1, 2016, 8:50:15 AM7/1/16
to FPGA-WARS: explorando el lado libre
También estaría el método showModal() ...

Ahora si, me voy a comer!!!


Un saludo,

@braincodec.


BrainCodec

unread,
Jul 1, 2016, 8:54:06 AM7/1/16
to FPGA-WARS: explorando el lado libre
La definitiva, también podrías utilizar un BOOTSTRAP MODAL y dentro el Alertify.

<div class="modal" id="DialogoEtiqueta"....></div>
...
$('#DialogoEtiqueta').modal('show');

Byez!

@braincodec

Jesús Arroyo

unread,
Jul 1, 2016, 9:06:02 AM7/1/16
to fpga-wars-explora...@googlegroups.com
Si, actualmente estoy utilizando modal: true. Por eso aparece el fondo más oscuro. Pero los eventos del $document escapan al modal. La solución es comprobar el estado.

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Obijuan

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Jul 1, 2016, 10:41:45 AM7/1/16
to FPGA-WARS: explorando el lado libre
+1 a la opción de exportar en modo pretty!!!  :-)


El viernes, 1 de julio de 2016, 14:21:29 (UTC+2), Jesús Arroyo escribió:
Correcto. De todas formas se me ocurre que podría ser interesante añadir la opción de exportar el verilog en formato "pretty", precisamente por lo que comentas de reutilizar código verilog.
El 1 de julio de 2016, 14:16, BrainCodec <brain...@gmail.com> escribió:
Con respecto a los identificadores, te lo comentaba por una mera cuestión de "reutilización" del código Verilog "desde fuera" de iceStudio, pero no hay problema un simple replace y listo! jejeje.


Un saludo.

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Eladio Delgado

unread,
Jul 2, 2016, 1:14:50 PM7/2/16
to FPGA-WARS: explorando el lado libre
Enhorabuena Jesús!!!

Acabo de probar el Icestudio 0.2.0 en W7-64 y va de lujo!!!

Lo he instalado en un portátil que uso para pruebas y he tenido que instalar python 2.7 y luego el toolchain desde el propio Icestudio. Listo! A programar la FPGA!

Ya me gustó cuando vi el video, pero hacerlo tú... estoy emocionado!!! Además me viene de muy bien para hacer las pruebas de los adaptadores de nivel de la IceZUM.

Aquí os dejo un pantallazo usando un divisor que me ha mandado Obijuan. Tengo la señal de 3MHz en la pantalla del osciloscopio :-)

Muchas gracias!!
Eladio



El miércoles, 29 de junio de 2016, 21:18:33 (UTC+2), Jesús Arroyo escribió:
Icestudio on W7-64.png

Obijuan

unread,
Jul 2, 2016, 1:45:02 PM7/2/16
to FPGA-WARS: explorando el lado libre
ooooooooeeeeeeeeeeeeeeeeee   Genial!!!!!!!!!!!!!

Ahora necesitamos beta-testers en mac


Saludos, Obijuan

Alex Tc

unread,
Jul 2, 2016, 1:46:04 PM7/2/16
to fpga-wars-explora...@googlegroups.com

Sin cacharro puedo probar algo?

--
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Jesús Arroyo

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Jul 2, 2016, 2:18:57 PM7/2/16
to fpga-wars-explora...@googlegroups.com

Obijuan

unread,
Jul 2, 2016, 2:32:48 PM7/2/16
to FPGA-WARS: explorando el lado libre
Hola Alex!

Por supuesto!  Si no tienes placa, no puedes cargar el bitstream, pero sí que lo puedes generar. Nos sería muy útil que probases el icestudio en el sistema operativo que uses:   Linux/Windows/mac  y nos dieses feedback de los problemas encontrados en la instalación.

El icestudio se instala a partir de los .zip que están aquí:

https://github.com/FPGAwars/icestudio/releases/tag/0.2.0-beta1

Elige el de tu S.O. Bájado y descomprímelo.
Luego ejecuta el Icestudio

Ahí ya puedes abrir algún ejemplo y darle a Tools / Build para sintetizar  (La primera vez te dirá que instales la toolschain primero con Tools/Install toolchain)

De momento tiene pocos ejemplos y bloques, pero Jesús lo ha diseñado para que se pueda ampliar fácilmente, añadiendo nuestros propios bloques


Saludos, Obijuan






El sábado, 2 de julio de 2016, 19:46:04 (UTC+2), Alex Tc escribió:

Sin cacharro puedo probar algo?

El 2 jul. 2016 7:45 p. m., "Obijuan" <obijua...@gmail.com> escribió:
ooooooooeeeeeeeeeeeeeeeeee   Genial!!!!!!!!!!!!!

Ahora necesitamos beta-testers en mac


Saludos, Obijuan

El sábado, 2 de julio de 2016, 19:14:50 (UTC+2), Eladio Delgado escribió:
Enhorabuena Jesús!!!

Acabo de probar el Icestudio 0.2.0 en W7-64 y va de lujo!!!

Lo he instalado en un portátil que uso para pruebas y he tenido que instalar python 2.7 y luego el toolchain desde el propio Icestudio. Listo! A programar la FPGA!

Ya me gustó cuando vi el video, pero hacerlo tú... estoy emocionado!!! Además me viene de muy bien para hacer las pruebas de los adaptadores de nivel de la IceZUM.

Aquí os dejo un pantallazo usando un divisor que me ha mandado Obijuan. Tengo la señal de 3MHz en la pantalla del osciloscopio :-)

Muchas gracias!!
Eladio


El miércoles, 29 de junio de 2016, 21:18:33 (UTC+2), Jesús Arroyo escribió:
Hola a todos,

Ya está disponible la primera beta de Icestudio 0.2.0 para Linux, Windows y Mac.

https://github.com/FPGAwars/icestudio/releases/tag/0.2.0-beta1

Es una versión con nuevos conceptos que explorar y desarrollar.

Toda duda, comentario o sugerencia comentadla en el hilo.

Que el software libre para hardware libre os acompañe! XD

--
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rafael lozano

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Jul 3, 2016, 4:14:09 AM7/3/16
to FPGA-WARS: explorando el lado libre
Buenos Días:

Mi experiencia es en windows10 64bit y funciona bien el entorno,  hasta que se fabrique la icezum no puedo hablar de la carga en tarjeta.

He estado creado un flipflop Rs y no logro terminarlo os adjunto imagen a ver que me dicen si es error mio o no. otra cosilla que echo en falta si es porque no la tiene o porque no encuentro la opción seria que tuviese Zoom.

Buen trabajo.

Un saludo.

El miércoles, 29 de junio de 2016, 21:18:33 (UTC+2), Jesús Arroyo escribió:

Alex Tc

unread,
Jul 3, 2016, 4:38:36 AM7/3/16
to fpga-wars-explora...@googlegroups.com
Me lo he bajado, y ejecutado en mi mac con capitán.

Ante todo. No tengo ni idea del entorno y soy un recién llegado, disculpad mi ignorancia y si meto la pata en algo:) 

El programa está suuuuper chulo, y tiene una apariencia sencilla y tranquilizadora, invita a toquetear ^_^

No he tenido ningún problema para instalarlo, viene directamente la app comprimida. Para usuarios de mac quizás sería mejor empaquetarlo en dmg y poner un acceso a la carpeta de aplicaciones, para abrirlo y solo arrastrar para "instalarlo" dentro de las aplicaciones.
  • El diagrama de bloques tiene un aspecto super chulo, pero permite colocar los bloques en sitios que permiten que las lineas queden ocultas detrás de los bloques. Normalmente este tipo de interfaces cuando sueltas el bloque, recolocan el mismo en la posición correcta mas cercana, o incluso no permiten mover el bloque a posiciones incorrectas. El hecho de que el bloque tenga código directamente me encanta!
  • Dando a build sin instalar el toolchain te dice en que menú tienes que instalarlo. Por que no directamente preguntarte si lo quieres instalar? y por que no lo instala directamente antes de hacer el build? El toolchain hay que reinstalarlo o algo? tiene alguna utilidad no tenerlo instalado? La aplicación podría instalarlo en cuanto la abres por primera vez.
  • Igual cuando ya tienes instalada la toolchain habría que indicarlo de algún modo. Con un check como el que indica para que placa estás trabajando estaría genial.
  • Cuando das a build, aparece un build start, que desaparece. Y te quedas en plan, ¿? ya esta? ya termino? algo fue mal? y luego aparece el build success, en mi maquina casi no tardó nada, pero si lo ejecutas en una máquina lenta igual desconcierta.
  • Cuando le das a un menú y se abre, si desplazas el raton lateralmente no abre el siguiente menu, tienes que hacer de nuevo click.
  • Si modificas un ejemplo, sin guardarlo, y lo vuelves a abrir, sigue modificado, incluso si abres otro ejemplo diferente en el medio.
  • Estaría genial como un comando de rearrange all, que reorganice los bloques.
  • Linea roja cuando conectas una asignación a una salida de bloque?
  • Zoom y cambio de tamaño con rueda please!
  • Las puertas se muestran en simbología Ansi, opción de elegir que simbología usar? dificulta el acceso a usuarios que han aprendido con una simbología distinta
  • Cuando insertas un bloque, puede aparecer en una posición donde ya hay uno, si el bloque es mas pequeño puede aparecer detrás de manera ninja.
  • Echo de menos poder ver las tripas, sería genial poder ver en una columna lateral el código que resulta de lo que vas construyendo, aunque no sea bidireccional (modificar código en columna y que se modifiquen los bloques), esto favorecería el salto de bloques a código y sería muy educativo.
  • Hay algún problemilla con la jerarquía de posiciones frente/fondo entre elementos de los bloques:
    • Imágenes integradas 1
    • Imágenes integradas 2
Un saludo y enhorabuena por el trabajazo!! es una chulada!!

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Jesús Arroyo

unread,
Jul 3, 2016, 6:38:36 AM7/3/16
to fpga-wars-explora...@googlegroups.com
Buenas Rafael,

Gracias por el feedback. Lo que te sucede se debe a una restricción para evitar los cortocircuitos en los puertos de entrada. Voy a analizarlo para solucionar este caso.

PD: el zoom y otras mejoras en la interfaz las tengo previstas para la beta2: https://github.com/FPGAwars/icestudio/issues/36.

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Jesús Arroyo

unread,
Jul 3, 2016, 7:11:49 AM7/3/16
to fpga-wars-explora...@googlegroups.com
Buenas Alex Tc,

Graciar por el feedback!

Te comento entre lineas.

El 3 de julio de 2016, 10:38, Alex Tc <alex.tc....@gmail.com> escribió:
Me lo he bajado, y ejecutado en mi mac con capitán.

Ante todo. No tengo ni idea del entorno y soy un recién llegado, disculpad mi ignorancia y si meto la pata en algo:) 

El programa está suuuuper chulo, y tiene una apariencia sencilla y tranquilizadora, invita a toquetear ^_^

No he tenido ningún problema para instalarlo, viene directamente la app comprimida. Para usuarios de mac quizás sería mejor empaquetarlo en dmg y poner un acceso a la carpeta de aplicaciones, para abrirlo y solo arrastrar para "instalarlo" dentro de las aplicaciones.

Me lo apunto.

Te respondo globalmente: voy a analizar los temas de interfaz gráfica para la siguiente beta. La verdad es que estoy aprendiendo tanto web como jointjs. JointJS tiene algunas limitaciones en la edición comunidad, pero nada es imposible y seguro que se pueden ir sacando las features que comentas.
  • El diagrama de bloques tiene un aspecto super chulo, pero permite colocar los bloques en sitios que permiten que las lineas queden ocultas detrás de los bloques. Normalmente este tipo de interfaces cuando sueltas el bloque, recolocan el mismo en la posición correcta mas cercana, o incluso no permiten mover el bloque a posiciones incorrectas. El hecho de que el bloque tenga código directamente me encanta!
Toda la lógica de layout hay que estudiarla. Los cables se colocan según un algoritmo para evitar objetos, si quedan detrás de bloques habrá que ver qué mejorar en ese algoritmo.

  • Dando a build sin instalar el toolchain te dice en que menú tienes que instalarlo. Por que no directamente preguntarte si lo quieres instalar? y por que no lo instala directamente antes de hacer el build? El toolchain hay que reinstalarlo o algo? tiene alguna utilidad no tenerlo instalado? La aplicación podría instalarlo en cuanto la abres por primera vez.
Ahora mismo la instalación no está automatizada, sino que es el usuario el que toma las decisiones. No es obligatorio la instalación de la toolchain para utilizar la herramienta, sin embargo es muy probable que quieras utilizarla. Además puede que no tengas Python 2.7 o conexión a internet cuando abrar la herramienta, por lo que debe existir la posiblidad de instalarlo a posteriori. Los paquetes de apio, el backend, pueden evolucionar por lo que sí tiene sentido actualizar. De todo esto creo que sería interesante lanzar directamente la instalación con Build o Upload si no está instalado en vez de notificarlo con un mensaje.

  • Igual cuando ya tienes instalada la toolchain habría que indicarlo de algún modo. Con un check como el que indica para que placa estás trabajando estaría genial.
La toolchain se puede actualizar, como comentaba antes. Quizá lo más adecuado sería cambiar el nombre a "Upgrade toolchain" si ya está instalada e "Install toolchain" si no está instalada.

  • Cuando das a build, aparece un build start, que desaparece. Y te quedas en plan, ¿? ya esta? ya termino? algo fue mal? y luego aparece el build success, en mi maquina casi no tardó nada, pero si lo ejecutas en una máquina lenta igual desconcierta.
El estado se indica actualmente con el Wait cursor. Las notificaciones de alertify tienen un tiempo fijo, aunque a lo mejor se puede hacer que permanezca un mensaje hasta que termine. Habrá que estudiarlo.

  • Cuando le das a un menú y se abre, si desplazas el raton lateralmente no abre el siguiente menu, tienes que hacer de nuevo click.
Me lo apunto.
  • Si modificas un ejemplo, sin guardarlo, y lo vuelves a abrir, sigue modificado, incluso si abres otro ejemplo diferente en el medio.
Esto ya está corregido: https://github.com/FPGAwars/icestudio/commit/2679282b983f979787bbdaefba3af8a2631c8941. Estará disponible en la beta2.
  • Estaría genial como un comando de rearrange all, que reorganice los bloques.
Cierto, aunque no tengo ni idea de cómo hacerlo. XD.
  • Linea roja cuando conectas una asignación a una salida de bloque?
Por qué motivo?
  • Zoom y cambio de tamaño con rueda please!
Apuntado para la beta2.
  • Las puertas se muestran en simbología Ansi, opción de elegir que simbología usar? dificulta el acceso a usuarios que han aprendido con una simbología distinta
No sería complicado almacenar los SVGs de las simbologías en distintos directorios que se seleccionaran con una opción de preferencia. Lo dejo a pull request ;)
  • Cuando insertas un bloque, puede aparecer en una posición donde ya hay uno, si el bloque es mas pequeño puede aparecer detrás de manera ninja.
Apuntado.
  • Echo de menos poder ver las tripas, sería genial poder ver en una columna lateral el código que resulta de lo que vas construyendo, aunque no sea bidireccional (modificar código en columna y que se modifiquen los bloques), esto favorecería el salto de bloques a código y sería muy educativo.
El código verilog generado tiene una pinta muy fea. Es código intermedio escrito por una máquina por lo que es bastante complicado aprender verilog con ese código generad. Sin embargo, tengo apuntada una feature para exportar el gráfico en código verilog con un formato un poquito más legible, pero insisto, esta herramienta está orientada para aprender electrónica, no verilog.
  • Hay algún problemilla con la jerarquía de posiciones frente/fondo entre elementos de los bloques:
    • Imágenes integradas 1
    • Imágenes integradas 2
Este problema me tiene un poco despistado. Tiene que ver con JointJS, que a su vez utiliza Backbonejs (ambas cosas las "acabo" de descubrir). Cada bloque básico está formado por dos componentes: los Elements, que pintan el bloque en SVG y los ElementView que pintan el HTML, en este caso los select y el editor. Parece que ambos componentes se comportan de forma independiente, con sus zs. Seguiré investigando a ver si encuentro lo que sucede.

Un saludo y enhorabuena por el trabajazo!! es una chulada!!

 
Gracias y un saludo!
 

Alex Tc

unread,
Jul 3, 2016, 7:39:04 AM7/3/16
to fpga-wars-explora...@googlegroups.com

Lo de la asignación a una salida de bloque lo decía por que si a un bloque que genera una salida le conectas una asignación de valor, no creas un cortocircuito? Igual estoy diciendo burrada 😅

Para lo de recolocar los bloques tiene que haber ya algún un algoritmo, muchos programas de chart lo hacen, y seguro que alguno open source. Supongo que será cuestión de ir asignando una jerarquía o pesos e ir colocando por orden.

Gracias por tus comentarios y sobre todo por tu trabajo!

Este año en la OSHWDem 2016, a parte de CloneWars... un reto FPGAWars?? 😏

Pepe Chorva

unread,
Jul 3, 2016, 2:59:36 PM7/3/16
to FPGA-WARS: explorando el lado libre
Tu ve diciendo fechas, que este año me guardo vacaciones… 😏😏😏
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Jesús Arroyo

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Jul 3, 2016, 3:33:47 PM7/3/16
to fpga-wars-explora...@googlegroups.com
Hola Alex Tc,

Los posibles cortocircuitos generados de forma gráfico están controlados por funciones de validación.

Me apunto lo de la OSHWDem 2016 también ;)


Juan Gonzalez Gomez

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Jul 4, 2016, 2:00:15 AM7/4/16
to FPGA-WARS: explorando el lado libre

rafael lozano

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Jul 18, 2016, 12:16:54 PM7/18/16
to FPGA-WARS: explorando el lado libre
Buenas tardes Jesús:

ya tengo icstick y estoy empezando a tomar contacto, he instalado los driver del ftdi correcto todo se me ha instalado en el com10(estoy en windows 10) lanzo el icstudio hago buil y todo pero cuando hago upload no me detecta la tarjeta. ¿ el icstudio detecta el puerto o hay que fijar algún com predeterminado para que cargue?

un SAVludo

Jesús Arroyo

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Jul 18, 2016, 12:57:32 PM7/18/16
to fpga-wars-explora...@googlegroups.com
Buenas,

Icestudio utiliza el backend apio (https://github.com/fpgawars/apio) para ejecutar el build y upload, que a su vez ejecuta las herramientas de icestorm. Estas herramientas son las que detectan la placa.

Para asegurar que tienes todo instalado correctamente ejecuta los siguientes pasos:

  1. Instala apio en tu sistema: abre una consola y ejecuta "pip install apio". Debes de asegurarte de tener Python 2.7 instalado y añadido al PATH del sistema.
  2. Instala las herramientas de testeo: "apio install system". Probablemente ya las tengas instaladas por Icestudio.
  3. Ejecuta "apio system lsftdi". Debería salir el siguiente output:

           Number of FTDI devices found: 1
           Checking device: 0
           Manufacturer: Lattice, Description: Lattice FTUSB Interface Cable

     4. Si te sale algo distinto vuelve a instalar los drivers: https://github.com/FPGAwars/libftdi-cross-builder/wiki#driver-installation.

Un saludo.


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rafael lozano

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Jul 18, 2016, 2:01:41 PM7/18/16
to FPGA-WARS: explorando el lado libre
gracias jesus por la ayuda que me estas prestando:
 he instalado todo he seguido la wiki y me sale esto

 he desinstalado los driver y los he vuelto a instalar con el zadig y este es el resultado.

Juan Gonzalez Gomez

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Jul 18, 2016, 2:48:01 PM7/18/16
to FPGA-WARS: explorando el lado libre
Hola Rafael,

Resumo en este cuadro el problema:

--------
Plataforma: Windows 10
Usuario: Rafael Lozado

Mensaje de error:

Number of FTDI devices found: 2
Checking device: 0
ftdi_usb_get_strings failed: -4 (libusb_open() failed)

Problema: Driver zadig no está funcionando
-----------

Es un problema de drivers.  Veo que el número de dispositivos que encuentra son 2. Esto es raro.
Si antes has instalado el driver ftdi, puede ser que se haya quedado algo.
Desinstala todo. Desconecta todas las placas que tengas y re-inicia el ordenador

Sin nada conectado, ejecuta find_all.exe (que ya lo tienes descargado. En realidad esto está integrado ya en apio, pero vamos a usarlo igualmente):

Te debería aparecer esto:

Number of FTDI devices found: 0

--> Pruébalo y dime exactamente qué te sale

Ahora conecta la icestick. Como el driver no está instalado, te debería aparecer algo como esto:


Number of FTDI devices found: 1
Checking device: 0
ftdi_usb_get_strings failed: -4 (libusb_open() failed)

--> Pruébalo y dime exactamente qué te sale


Ahora instalada zadig. Y vuelve a probar. Debería salir esto:


Number of FTDI devices found: 1
Checking device: 0
Manufacturer: Lattice. Description: Lattice FTUSB Interface Cable

--> Pruébalo y dime exactamente qué te sale

Según los resultados vemos cómo seguir

Saludos, Obijuan



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rafael lozano

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Jul 19, 2016, 12:53:59 PM7/19/16
to FPGA-WARS: explorando el lado libre

Buenas tardes: 
primero contesto y despues expongo.
He desinstalado desde el administrador de dispositivos he arrancado el pc de nuevo y indicandome que tengo 0 dispositivos

conecto la icstick y ya me aperecen los 2 dispostivos con el correspondiente error







Ahora con ella conectada desinstalo los drivers desde el administrador de dispositivos y ya me queda solo 1 con su correspondiente error. Pero si lo conecto y lo vuelvo a conectar ya aparecen los dos.



Ahora expongo:

 Los driver ftdi la primera vez los instalé desde su pagina oficial y despues utilicé esta aplicacion para instalar driver libusb-win32-bin-1.2.6.0. el caso es que aunque desinstale desde el administrador y desde el system32 y el syswow64 los driver siguen teniendo presencia. 


ya solo me queda hacer el proceso en otra maquina limpia.



un saludo



Obijuan

unread,
Jul 19, 2016, 2:13:36 PM7/19/16
to FPGA-WARS: explorando el lado libre
Hola Rafael,

  Si puedes probar en una máquina limpia con windows 10 sería genial. NO instales los drivers del FTDI de la página oficial. Instala sólo el zadig

  ¿Algún usuario de Windows 10 que pueda echar una mano? 

Lo que te ha ocurrido de los 2 drivers, le puede pasar a más gente, por lo que sería genial la receta para volver al estado inicial

Saludos, Obijuan

rafael lozano

unread,
Jul 19, 2016, 6:15:45 PM7/19/16
to FPGA-WARS: explorando el lado libre
He probado en otro ordenador y todo sigue igual los 2drivers y el error

Obijuan

unread,
Jul 20, 2016, 2:08:49 AM7/20/16
to FPGA-WARS: explorando el lado libre
Parece una cosa de Windows 10. Abro un hilo nuevo específico para windows 10. Necesitamos beta-testers para esa plataforma
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